FPGA를 이용한 100 kHz 스위칭 주파수의 3상 3-level과 2-level의 SVPWM의 구현
Three-phase 3-level and 2-level SVPWM Implementation with 100 kHz Switching Frequency using FPGA
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초록
본 논문은 FPGA의 언어 중 하나인 Verilog HDL을 사용한 100 kHz 스위칭의 3-레벨, 2-레벨 SVPWM 기법을 구현에 대한 것이다. 인버터에 주로 사용되는 IGBT소자의 경우 주로 20 kHz 근방에서 스위칭 주파수를 가진다. 최근 차세대 전력 반도체 소자의 연구 개발로 100 kHz 이상의 스위칭을 구현하여 전력변환기를 소형화하고, 고조파의 주입에 따른 여러 가지 새로운 알고리즘의 적용이 가능하게 되었다. IGBT를 이용하는 기존의 시스템에서는 DSP를 이용한 제어가 이루어지는 것이통상적이나, 100 kHz 스위칭을 위한 제어기 구성으로는 FPGA를 이용한 제어기의 적용이 요구된다. 따라서 본 논문에서는FPGA를 사용하여 2-레벨 인버터와 3-레벨 인버터에 적용되는 SVPWM의 이론과 FPGA 구현에 대하여 설명하고 SVPWM의 출력 파형을 통해 구현 성능을 확인한다. 한편, 본 논문에서는 3-레벨 인버터에서 SVPWM 구현 시 기존의 방식에서 반송파 2 개를 사용하는 방법을 대신하여 반송파 1개만을 사용하는 기법으로 3-레벨 SVPWM을 구현한다.
Abstract
This paper presents a 3-level, 2-level SVPWM technique with 100 kHz switching using Verilog HDL, one of thelanguages of FPGA. In the case of IGBT devices mainly used in inverters, they have a switching frequency around20kHz. Recent research and development of next-generation power semiconductor devices such as GAN has enabledswitching of more than 100kHz, which can miniaturize power converters, and apply various new algorithms due to theinjection of harmonics. In the existing system using the IGBT, the control using the DSP is common, but the controllerconfiguration for 100 kHz switching requires the use of FPGA. Therefore, this paper explains the theory andimplementation of SVPWM applied to two-level and three-level inverters using FPGAs and verifies the performancethrough the output waveform. In addition, this paper implements 3-level SVPWM by using only one carrier instead ofusing two carriers in the conventional method.
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